65C832: Różnice pomiędzy wersjami
Nie podano opisu zmian |
Nie podano opisu zmian |
||
| Linia 1: | Linia 1: | ||
Mityczny, 32-bitowy następca procesora [[65C816]]. Przy wciąż ośmiobitowej (!) szynie danych miał mieć 32-bitowe rejestry - licząc w tym także wskaźnik stosu i rejestr D - oraz zintegrowany koprocesor artymetyczny. Procesor miał być przy tym zgodny co do wyprowadzeń z istniejącym [[65C816]] - czyli mimo wewnętrznej organizacji 32-bitowej i 32-bitowych rejestrów adresowych miał być wciąż ograniczony do 16 MB pamięci. | Mityczny, 32-bitowy następca procesora [[65C816]]. Przy wciąż ośmiobitowej (!) szynie danych miał mieć 32-bitowe rejestry - licząc w tym także wskaźnik stosu i rejestr D - oraz zintegrowany koprocesor artymetyczny. Procesor miał być przy tym zgodny co do wyprowadzeń z istniejącym [[65C816]] - czyli mimo wewnętrznej organizacji 32-bitowej i 32-bitowych rejestrów adresowych miał być wciąż ograniczony do 16 MB pamięci. | ||
Nie wydaje się, by 65C832 kiedykolwiek osiągnął stadium nawet prototypu. | Nie wydaje się, by 65C832 kiedykolwiek osiągnął stadium nawet prototypu. Mimo tego, co twierdzą niektóre źródła, zob. [http://apple2history.org/museum/articles/microreport/microreport.html]. | ||
[http://apple2.org.za/gswv/a2zine/Docs/CPU_65832/ | === Fałszywy manual? === | ||
W sieci można znaleźć [http://apple2.org.za/gswv/a2zine/Docs/CPU_65832/ materiały], które mają być zeskanowanymi stronami dokumentacji, jaką producent przygotował dla 65C832. Jednak wnikliwa lektura nasuwa wątpliwości co do autentyczności tego dokumentu: | |||
* dokumentacja wymienia nowy rozkaz XFE, chociaż już w tabeli opcodów [[65C816]] brak jest na cokolwiek miejsca; | * dokumentacja wymienia nowy rozkaz XFE, chociaż już w tabeli opcodów [[65C816]] brak jest na cokolwiek miejsca; | ||
Wersja z 3 lis 2005, 05:50
Mityczny, 32-bitowy następca procesora 65C816. Przy wciąż ośmiobitowej (!) szynie danych miał mieć 32-bitowe rejestry - licząc w tym także wskaźnik stosu i rejestr D - oraz zintegrowany koprocesor artymetyczny. Procesor miał być przy tym zgodny co do wyprowadzeń z istniejącym 65C816 - czyli mimo wewnętrznej organizacji 32-bitowej i 32-bitowych rejestrów adresowych miał być wciąż ograniczony do 16 MB pamięci.
Nie wydaje się, by 65C832 kiedykolwiek osiągnął stadium nawet prototypu. Mimo tego, co twierdzą niektóre źródła, zob. [1].
Fałszywy manual?
W sieci można znaleźć materiały, które mają być zeskanowanymi stronami dokumentacji, jaką producent przygotował dla 65C832. Jednak wnikliwa lektura nasuwa wątpliwości co do autentyczności tego dokumentu:
- dokumentacja wymienia nowy rozkaz XFE, chociaż już w tabeli opcodów 65C816 brak jest na cokolwiek miejsca;
- rozkazu XFE brak jest też w ogólnym zestawieniu rozkazów, które ma postać tabeli identycznej do tej, która widnieje w manualu od 65C816; widnieje na niej za to zarezerwowany w 65c816 rozkaz WDM; wg innych źrodeł kod ten miał być użyty w przyszłości nie jako oddzielny rozkaz, ale jako prefiks do zdublowania tabeli rozkazów
- dokument wzmiankuje podział przestrzeni adresowej na 16 MB pamięci programu oraz 4 GB pamięci danych, mimo że - zgodnie z powyżej opisanymi założeniami - procesor miał mieć w ogóle tylko 24-bitową szynę adresową (!)
- brak jest kompletnie wzmianki o koprocesorze artymetycznym oraz rozkazach całkowitoliczbowego dzielenia i mnożenia, które wg innych źrodeł nowy procesor miał mieć
Zobacz też: